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这个问题比较专业,在网上可能不能找到好的答案,所以这个答案建议在CSDN技术专区里面找到稳妥的答案。
单片机输出高电平的时候,基本没有输出电流的能力,上拉电阻,是用来辅助输出电流的。4K7,在很多的说明材料中,都用了这个数值。它应该是““为IIC器件提供所需要电流””的最合理数值。
可以的。5V供电的话,一般选择10K,当然,大一点也无所谓,10K~51K都行,这个没有限制。
有些单片机的管脚是内置可选的上/下拉电阻的。这种情况下如果跑低速IC(100kHz以下),开内置上拉即可。
单片机中iic总线的上拉电阻没有稳压作用,提供这个上拉是为了多器件并联在总线上。
视节点数目、单片机管脚电气类型、走线距离、通讯速率影响,上拉电阻的阻值是不定的、甚至可以不加(管脚弱上拉都已经够了)。
1、接上拉、下拉,可以使得该PIN的电平为固定状态,可以抗扰,尤其是对于CMOS芯片,悬空的PIN必需上拉、下拉。
2、这个电阻可以放在发送端,那么接受端还需要端接处理,也可以放到接受端,这时候端接电阻和偏置电阻就是一个。PECL电路结构上就好像CML后面跟了一个射极跟随器。OC门也使用上拉电阻,这个和CML有一点相像,但是还不太一样。
3、真故障安全接收器(Ture Fail-Safe Receivers)(可以省上下拉电阻)新一代RS-485接收器经过改进,使差分输入阈值电压从±200mV调整至-200mV和-30mV,这样就可以省去使用上下拉电阻。
在CMOS芯片上,为了防止静电造成损坏,不用的管脚不能悬空,一般接上拉电阻以降低输入阻抗, 提供泄荷通路。
上拉电阻是用来解决总线驱动能力不足时提供电流的。一般说法是拉电流,下拉电阻是用来吸收电流的,也就是通常所说的灌电流。
为增强输出引脚的驱动能力,有的单片机管脚上也常使用上拉电阻。在CMOS芯片上,为了防止静电造成损坏,不用的管脚不能悬空,一般接上拉电阻以降低输入阻抗, 提供泄荷通路。
上拉电阻一般就弄个10K。无论是对于哪种芯片IIC的时序是没多大差别的,弄个大概出来,在用示波器看,再比较手册,看哪不对再改。这样是调IIC最好方法。
IIC总线CLK要用推挽,数据总线在送出信号时设置成推挽,输入如果没有上拉电阻时配置成上拉输入,有上拉则配置成浮空输入。SPI总线的CLK,CS,MOSI脚设置成推挽,MISO脚配置成上拉输入。
内部上拉下拉都是电流源电路,且电流比较小,因此受外部阻抗变化影响大,有些情况不可用。 外加的话只要在驱动能力范围内,需要多少阻值就用多少阻值。
开漏输出就是不输出电压,低电平时接地,高电平时不接地。如果外接上拉电阻,则在输出高电平时电压会拉到上拉电阻的电源电压。这种方式适合在连接的外设电压比单片机电压低的时候。
1、单片机输出高电平的时候,基本没有输出电流的能力,上拉电阻,是用来辅助输出电流的。4K7,在很多的说明材料中,都用了这个数值。它应该是““为IIC器件提供所需要电流””的最合理数值。
2、单片机中iic总线的上拉电阻没有稳压作用,提供这个上拉是为了多器件并联在总线上。
3、I2C总线只有两根双向信号线。一根是数据线SDA,另一根是时钟线SCL。I2C总线通过上拉电阻接正电源。当总线空闲时,两根线均为高电平。
4、OC门电路必须加上拉电阻,才能使用。为加大输出引脚的驱动能力,有的单片机管脚上也常使用上拉电阻。在COMS芯片上,为了防止静电造成损坏,不用的管脚不能悬空,一般接上拉电阻产生降低输入阻抗,提供泄荷通路。
5、当P0=0时P0点为低电位,发光管亮起,流过D1的电流约为15mA。当P0=1时,P0点为悬空,但发光管和180欧电阻都是低阻抗元件,P点电位就为高电位,再说也无任何输出影响,因此这样电路是可以的。
6、老51 P0口,没有上拉,是作为总线用,若作为输出口,没有上拉,将没有高电平。其他口,上拉电流只能达到160微安,不能推动较大负载,所以有时要加上拉电阻。若低电平有效,可以不加。
1、可以低到3V。放心吧!就是说这个pin是iic专用的。但是有协议。不要超过协议电压。不太清楚。但是我觉得这是为iic提供一个备用电源。
2、这不是上拉电阻接多少电压能解决的。因为单片机能识别的逻辑电平,ADS1115受不了。ADS1115能承受的逻辑电平,单片机识别不了。I2C总线是双向的,简单的电平移位是行不通的。
3、你是说两个芯片用I2C通信,但他们一个是5V一个是3V供电这杨么??没问题的,因为I2C总线是开漏输出,所以,两个上拉电阻接到3V就行了。
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