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1、下拉电阻是串接电阻后接地，目的是把该点的电压拉低..也可以说可以提高端口的灌电流能力。需要用到上拉电阻和下拉电阻的情况还蛮多的，画图比较麻烦。
2、上拉电阻就是把引脚的电平拉高（往上拉），那电阻一端接在电源VCC上，另一端接在引脚上。下拉电阻就是把引脚的电平拉低（往下拉），那电阻一端接在地GND上，另一端接在引脚上。
3、上拉电阻是在数字逻辑（正逻辑）输出电路中接在输出端和电源正极之间的电阻，当输出为高电平时，它能使得输出端切实达到高电平。
4、上拉就是将不确定的信号通过一个电阻钳位在高电平，电阻同时起限流作用。
在CMOS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻以降低输入阻抗， 提供泄荷通路。
下拉电阻就是在某电位点用电阻与地相连的电阻。如果某电位点有下拉和上拉电阻就组成了分压电路，此时，电阻又叫分压电阻。
上拉就是将不确定的信号通过一个电阻钳位在高电平，电阻同时起限流作用。
所谓上，就是指高电平；所谓下，是指低电平。上拉，就是通过一个电阻将信号接电源，一般用于时钟信号数据信号等。下拉，就是通过一个电阻将信号接地，一般用于保护信号。
概括地说，上拉电阻是将不确定的信号通过一个电阻钳在高电平，同时起限流作用，下拉是将不确定的信号通过一个电阻钳在低电平，同时起限流作用。上拉是对器件注入电流，下拉是输出电流。
下拉电阻的工作原理是什么？－－很简单的。－－就是《电路》课程的知识。下拉电阻接地与端口相连接，那它是是怎么保持低电平电压的？－－它不会保持低电平电压的。－－当你在端口输出高电平，它，就是高电平。
下拉电阻的主要作用是与上接电阻一起在电路驱动器关闭时给线路（节点）以一个固定的电平。 三极管发射极加上下拉电阻（Re）也就是图上的R4是为了设置一个偏置电压，也是负反馈电阻。
上拉就是将不确定的信号通过一个电阻钳位在高电平，电阻同时起限流作用。下拉同理，也是将不确定的信号通过一个电阻钳位在低电平。
下拉电阻是串接电阻后接地，目的是把该点的电压拉低..也可以说可以提高端口的灌电流能力。需要用到上拉电阻和下拉电阻的情况还蛮多的，画图比较麻烦。
所谓上，就是指高电平；所谓下，是指低电平。上拉，就是通过一个电阻将信号接电源，一般用于时钟信号数据信号等。下拉，就是通过一个电阻将信号接地，一般用于保护信号。
下拉电阻的主要作用是与上接电阻一起在电路驱动器关闭时给线路（节点）以一个固定的电平。
问题三：上拉电阻和下拉电阻分别是什么意思，解释通俗易懂一点 所谓上，就是指高电平；所谓下，是指低电平。上拉，就是通过一个电阻将信号接电源，一般用于时钟信号数据信号等。
在CMOS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻以降低输入阻抗， 提供泄荷通路。
驱动能力与功耗的平衡。以上拉电阻为例，一般地说，上拉电阻越小，驱动能力越强，但功耗越大，设计是应注意两者之间的均衡。下级电路的驱动需求。
通过上拉电阻或者下拉电阻就可以使电路处于稳定的状态，具体视设计要求而定。
上拉电阻：（1）增加高电平的带载能力。（2）保证端口静态是高电平 。下拉电阻：（1）保证端口静态是低电平。（2）降低端口的阻抗，减少噪声干扰。不同性质的电路，电阻值不同，如 TTL 与 CMOS 。
确认初始态。这个对于采用cmos工艺的数字电路尤其重要。因为如果不加上拉电阻或下拉电阻，当电路上电后，栅电压属于三态（可高可低），对内部电路初始态会造成影响。增加上拉电阻或下拉电阻会对数字信号的沿造成影响。
长线传输中加上拉，是阻抗匹配抑制反射干扰。原则： 从节约功耗和芯片的电流的能力来考虑，应是电阻尽量大，R大，I小。 从确保驱动能力来考虑，应当电阻足够小，R小，I大。
1、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限，增强抗干扰能力；提高总线的抗电磁干扰能力，管脚悬空就比较容易接受外界的电磁干扰。
2、上拉就是将不确定的信号通过一个电阻钳位在高电平，电阻同时起限流作用。
3、拉电阻是用来解决总线驱动能力不足时提供电流的。一般说法是拉电流，下拉电阻是用来吸收电流的，也就是灌电流。
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